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Title: Multicore Reconfiguration Platform - A Research and Evaluation FPGA Framework for Runtime Reconfigurable Systems
Other Titles: Multicore Reconfiguration Platform - Ein Forschungs- und Evaluations FPGA Framework für laufzeitrekonfigurierbare Systeme
Authors: Meyer, Dominik 
Language: en
Subject (DDC): Informatik
Subject: Laufzeit Rekonfiguration
Universalrechner
FPGA
Dynamic Runtime Reconfiguration
General-Purpose Computing
Field Programmable Gate Array
Rekonfiguration
Issue Date: 2015
Publisher: Universitätsbibliothek der HSU/UniBwH
Document Type: Thesis
Source: elektronische Quelle (2015)
Publisher Place: Hamburg
Abstract: 
Field Programmable Gate Arrays (FPGAs) erlauben die Veränderung ihrer Hardwarefunktionalität noch nach ihrer Produktion. Sie kommen in Forschung und Wirtschaft immer mehr zum Einsatz. Ihre Hauptanwendungsbereiche sind derzeit Hardware Prototyping und High Performance Computing. Die vorliegende Arbeit schlägt eine Erweiterung der Anwendungsbereiche auch auf Universalrechner, wie zum Beispiel Standard PCs, vor. Von dieser Erweiterung werden sich Leistungssteigerungen für Anwendungen und eine verringerter Strombedarf versprochen. Typische Anwendungen, die von dieser Erweiterung profitieren würden, sind Bildbearbeitungsprogramme und physikalische Simulationen, zum Beispiel in den Bereichen elektromagnetischer Felder oder der Festkörperphysik. Die Analyse der Anforderungen an den Entwicklungsprozess und des zu verwendenden FPGA Designs ergab, dass beide sehr flexibel gestaltet werden müssen, dass Hardwarebausteine zur Laufzeit austauschbar sein müssen und dabei, bereits laufende Berechnungen, nicht stören dürfen. Eine gute Betriebssystemintegration ist ebenfalls wichtig. Als ein großes Problem wurde das Granularitätsproblem erkannt, welches auftritt, wenn viele verschieden große Komponenten mit guter Platzausnutzung auf einem FPGA platziert werden sollen. Die Arbeit präsentiert zwei Lösungsvorschläge für das Granularitätsproblem. Der erste stellt auf dem FPGA Gruppen für unterschiedlich große Komponenten bereit und der zweite teilt den FPGA in viele kleine und gleichgroße Plätze für Komponenten auf. Größere Komponenten müssen dann auf mehrere kleine Plätze verteilt werden. Außerdem beschreibt die Arbeit ein mehr FPGA Framework, welches den zweiten Lösungsvorschlag verwendet, um ein für Universalrechner optimiertes, zur Laufzeit partiell rekonfigurierbares System, bereitzustellen. Diese Multicore Reconfiguration Platform (MRP) erlaubt es, komplexe Hardwarebausteine in viele kleinere zu zerlegen und diese dann einzeln auf dem FPGA zu konfigurieren. Diese werden dann über ein leitungsvermittelndes Netzwerk miteinander verbunden. Außerdem lässt sich das MRP einfach, durch Hinzufügen weiterer FPGAs, erweitern und bietet den Zugriff auf externe FPGA Board Komponenten an. Die Verbindung zu einem Universalrechner wird durch eine 1Gbit Ethernet Verbindung bereitgestellt. Für das Betriebssystem Linux wurden Treiber entwickelt, die die einfache Integration des MRP durch Socket Netzwerkprogrammierung erlauben. Das MRP wird in den Dimensionen Zeit und Raum, sowie durch eine Beispiel Anwendung evaluiert. Als Beispielanwendung wurde ein kleiner Mikrokontroller auf das MRP portiert und Beispielrechnungen damit durchgeführt. Zum Abschluss bietet die Arbeit einen kurzen Ausblick auf noch offene Fragestellungen bei der Kopplung von FPGAs und Universalrechnern.
Organization Units (connected with the publication): Technische Informatik 
DOI: https://doi.org/10.24405/551
URL: http://edoc.sub.uni-hamburg.de/hsu/volltexte/2015/3098/
Advisor: Klauer, Bernd 
Referee: Zölzer, Udo
Grantor: HSU Hamburg
Type of thesis: Doctoral Thesis
Exam date: 2015-03-16
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