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Low-Latency FIR Filter Structures Targeting FPGA Platforms

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dc.contributor.author Eckert, Marcel
dc.contributor.author Klauer, Bernd
dc.contributor.author Rivera Benois, Piero Iared
dc.contributor.author Nowak, Patrick
dc.contributor.author Zölzer, Udo
dc.date.issued 2018
dc.description HEART 2018
dc.description.version NA
dc.identifier.citation Enthalten in: HEART 2018. - Toronto : University of Toronto, 2018
dc.identifier.doi 10.1145/3241793.3241807
dc.identifier.uri https://openhsu.ub.hsu-hh.de/handle/10.24405/6527
dc.language.iso en
dc.publisher University of Toronto
dc.relation.orgunit Technische Informatik
dc.relation.orgunit Allgemeine Nachrichtentechnik
dc.rights.accessRights metadata only access
dc.title Low-Latency FIR Filter Structures Targeting FPGA Platforms
dc.type Conference paper
dcterms.bibliographicCitation.originalpublisherplace Toronto
dspace.entity.type Publication
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